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Dual RF LDMOS Bias Controllers
with I 2 C/SPI Interface
Functional Diagram
SAFE1
SAFE2
ALARM
AV DD
DIGITAL
CURRENT AND
PGAOUT1
DV DD
TEMPERATURE
DGND
COMPARATORS
PGA1
CS1+
CS1-
PGA REGISTERS
CS2-
SCL
PGA2
CS2+
SDA/DIN
A0/CSB
SERIAL
INTERFACE
REGISTER
SECTION
PGAOUT2
A1/DOUT
A2/N.C.
CHANNEL 1 DAC
V REFDAC
OPSAFE1
REGISTERS
8-BIT HIGH CODE
8-BIT LOW CODE
10-BIT FINE
ADJUST CODE
CHANNEL 1 DAC
REGISTERS
8-BIT HIGH CODE
8-BIT LOW CODE
10-BIT FINE
ADJUST CODE
10-BIT DAC
V REFDAC
10-BIT DAC
MAX1385
MAX1386
DRV
DRV
TEMP
SENSOR
PGAOUT1
GATE1
GATEV DD
GATEGND
OPSAFE2
GATE2
AGND
FIFO
MEMORY
12-BIT ADC
WITH T/H
MUX
PGAOUT2
ADCIN0
ADCIN1
V REFDAC
2.5V
V REFADC
CONVERSION AND
EXTERNAL
TEMP
PROCESSING
DXP1
DXN1
DXP2
DXN2
REF
REFDAC REFADC
SCAN OSCILLATOR
AND CONTROL
CNVST
______________________________________________________________________________________
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